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[zn_cu_li]

孙博士，您好：

 

我想研究定向耦合器（DC）耦合长度与耦合效率的关系。

用EME初步确定了DC最佳耦合长度为300um左右。

我将EME中的模型直接导入了FDTD，仿真结果是发散的。

当我检查我的模型时，我将耦合区长度设置为30um、50um、100um时，结果均是收敛的。

也就是说，只有当我仿真更长的器件时，结果才会发散。

我也尝试单独仿真DC后面的S波导，结果也是收敛的。

也就是说，目前就是因为仿真器件太长造成的不收敛，但DC耦合最佳效率与长度密切相关，我无法在缩短器件长度的情况下，得到准确结果

 

我尝试过用论坛中“Ansys Insight: FDTD 和 varFDTD 常见的发散原因以及处理”提到的一整套操作方式来解决问题，但并没有效果。

 

我想请问，当FDTD仿真超长器件时，有什么更好的方法吗。

 

以下是我分别仿真300umDC+S波导和100umDC时，monitor监测到的电场分布。

除了改变FDTD的“x max”，两次仿真其他参数均未改变。

[Guilin Sun]

首先，仿真器件太不长造成的不收敛！是其它问题导致的。

器件长度改变对于FDTD来说就是不同的器件！不同的器仿真可能有不同的问题。

你需要看看为什么这里场很强

很可能是PML不合适导致的反射。

尽管你参考帖子还没有解决，你还是要想办法看看是什么原因，你可以用电影监视器，还有记录PML里面的场看看是不是很强？如果强那就是PML的问题：

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